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if block erklärung

 

longdon
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     Beitrag Verfasst am: 13.03.2012, 20:23     Titel: if block erklärung
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hey leute:)
ich habe ein if block in simulink
auf u1 liegt vmax auf u2 vsoll
wie kann ich mit dem block realisieren das wenn

vmax<vsoll ist, er vmax fährt? ich hab es mit einem if block probiert blos bei zwei eingängen und zwei ausgängen verstehe ich nicht wie das funktioniert wenn ich nicht bestimmen kann WAS ausgegeben wird.. ich habe eingetippt u1 < u2 und habe einen ausgang und den else ausgang. blos wie kann ich einstellen was er da ausgibt. das bsw . vmax(u1) jetzt bei dem if raus geht. ? weis das jemand?
das wäre voll gut Smile
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Harald
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     Beitrag Verfasst am: 13.03.2012, 21:22     Titel:
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Hallo,

Funktionsweise des if-Block:

Das mittlere Signal ist das Steuersignal. Wenn die Bedingung erfüllt ist (Schwellwert und Art der Bedingung kann durch Doppelklick eingestellt werden), wird das obere Signal durchgeleitet, ansonsten das untere. Das dürfte aber auch in der Doku des Blocks stehen Wink

Grüße,
Harald
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longdony

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     Beitrag Verfasst am: 14.03.2012, 11:22     Titel:
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hey harald

danke dir ! so habe jetzt u1 mit vmax und u2 vsoll

if( u2 > u1 ) liegt somit vmax auf dem ausgang, den zweiten ausgang bekomme ich jetzt aber irgendwie nicht an das den gleichen output vom subsytem gepackt.. wollte jetzt quasie den ausgang vom elseauf die gleiche buchse vom subsystem legen- das scheint aber nicht zu gehen.. weist du warum?
 
Harald
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     Beitrag Verfasst am: 14.03.2012, 11:30     Titel:
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Hallo,

ich verstehe deine Erklärung dessen, was du machen willst, leider nicht.

Vielleicht klappts so: Gib doch bitte mal in MATLAB- oder Pseudocode an, was gemacht werden soll; etwa in folgender Form:
Code:
if Bedingung
    Anweisung 1
else
    Anweisung 2
end


Grüße,
Harald
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longdon
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     Beitrag Verfasst am: 14.03.2012, 13:08     Titel:
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nochmal anders

es gibt zwei eingänge für den ifblock u1= vmax u2 = vsoll


der if block soll können

if vsoll > vmax
soll vmax ausgegeben werden...


else vsoll < vmax
ausgabe vsoll
end


also vmax begrenzt vsoll
ist vsoll größer als vmax soll er vmax ausgeben
ist vsoll kleiner als vmax dann vsoll

eigentlich soll er immer vsoll ausgeben ausser vsoll liegt über vmax dann muss er vmax ausgeben Smile

so sollte es verständlich sein Smile

danke für deine viele hilfe!
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Harald
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     Beitrag Verfasst am: 14.03.2012, 13:21     Titel:
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Hallo,

ich habe ein kleines Beispiel angehängt.

Da du im Grunde das Eingangssignal sättigen möchtest, ist der Saturation-Block hierfür an sich geeigneter.

Falls vmax variiert, kannst du dir ansehen, wann die Differenz der Signale größer als 0 ist, und deine Entscheidung danach treffen.

Grüße,
Harald

vmaxvsoll2.mdl
 Beschreibung:
2.Version (geht auch, wenn beide Signale mit Zeit variieren)

Download
 Dateiname:  vmaxvsoll2.mdl
 Dateigröße:  25.22 KB
 Heruntergeladen:  517 mal
vmaxvsoll.mdl
 Beschreibung:
1.Version

Download
 Dateiname:  vmaxvsoll.mdl
 Dateigröße:  25.93 KB
 Heruntergeladen:  533 mal
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longdon
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     Beitrag Verfasst am: 14.03.2012, 13:29     Titel:
  Antworten mit Zitat      
das ist das ding

vmax kommt aus einem anderen block und ändert sich kontinuierlich genau wie vsoll ( wird bestimmt durch eine strecke, kurven etc)

beide werten werden also übergeben und sind dynamisch..
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Harald
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     Beitrag Verfasst am: 14.03.2012, 13:35     Titel:
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Hallo,

dann schau dir bitte das zweite Beispiel in meinem letzten Kommentar an?

Grüße,
Harald
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longdon
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     Beitrag Verfasst am: 14.03.2012, 13:35     Titel:
  Antworten mit Zitat      
hallo,

ich glaube ich habe es jetzt erst verstanden ich nehme mal das zweite

zur erklräung: vsoll geht durch

wenn vmax - vsoll > 0 ist leitet er vmax durch?

so habe ich das modell verstanden.. das ist aber falsch er soll ja sagen das wenn vsoll - vmax > 0 ist soll er vmax durchleiten!

hast du den addblock falsch verbunden oder habe ich es falsch verstanden?

beste grüße

longdon
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Harald
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     Beitrag Verfasst am: 14.03.2012, 13:46     Titel:
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Hallo,

Zitat:
wenn vmax - vsoll > 0 ist leitet er vmax durch?

so habe ich das modell verstanden.. das ist aber falsch er soll ja sagen das wenn vsoll - vmax > 0 ist soll er vmax durchleiten!


Dann vertausche halt die Vorzeichen?

Grüße,
Harald
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longdon
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     Beitrag Verfasst am: 14.03.2012, 13:49     Titel:
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ja dachte ich mri auch. wollte blos wissen ob du das falsch rum angekabelt hast. im zweifelsfall gehe ich ersteinmal davon aus das ich es nicht verstanden habe, wenn der top-poster mir was programmiert was nicht läuft. danke dir großer.
du bist echt hilfsbereit Smile
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longdon
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     Beitrag Verfasst am: 14.03.2012, 13:54     Titel:
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so ab in die uni Smile

muss da noch paar parts vom tool durchsprechen Smile

schönen tag noch großer Smile

beste grüße longdon
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Harald
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     Beitrag Verfasst am: 14.03.2012, 15:18     Titel:
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Hallo,

ich schreibe zwar viel hier, bin aber auch nur ein Mensch. Und Vorzeichenfehler sind nur allzu menschlich. Für Mathematiker erst recht Wink

http://homepage.ruhr-uni-bochum.de/sven.kessler/mwitze.htm#24

Grüße,
Harald
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